Des physiciens allemands battent un record de vitesse de transmission de données : une puce à 500 Gbit/s créée
Des scientifiques de l'université de Paderborn ont développé une puce en silicium-germanium capable de traiter plus de 500 Gbit/s sur un seul canal, un record mondial d'une importance cruciale pour le développement de l'IA, des véhicules autonomes et des réseaux de communication dorsaux.
Record SiGe de Paderborn : pourquoi votre centre de données ne verra pas les 500 Gbit/s, mais Broadcom si
L'essentiel : ce qui se passe vraiment
Le 5 mai 2026, l'équipe du professeur Christoph Scheytt de l'université de Paderborn a publié les résultats du projet PACE — une puce "track-and-hold" en silicium-germanium traitant plus de 500 Gbit/s sur un seul canal. En configuration multicanal, ils revendiquent une barre au-dessus de 100 Tbit/s. Les gros titres ont explosé : "record mondial", "révolution pour l'IA", "percée réseau".
En réalité, ce n'est pas une révolution mais une démonstration d'une limite technologique. L'équipe de Scheytt a pris une puce fonctionnant à des fréquences où les instruments de mesure existants sont déjà "à la limite des capacités techniques" et a prouvé que le SiGe BiCMOS n'a pas dit son dernier mot. Mais entre un record en laboratoire et une puce dans votre serveur, il y a un écart d'au moins cinq ans et plusieurs centaines de millions d'euros. La véritable histoire ici n'est pas la vitesse, mais le moment où le silicium-germanium retire la couverture des interconnexions optiques.
Chronologie et contexte
L'histoire ne commence pas en mai 2026, mais en 2018, lorsque la Fondation allemande pour la recherche (DFG) a lancé le programme prioritaire SPP 2111 "Systèmes intégrés électroniques-photoniques pour le traitement de signaux à ultra-large bande". Le responsable du programme est le professeur Christoph Scheytt, une figure légendaire : fondateur d'advICo microelectronics, ancien responsable de la conception de circuits à l'Institut Leibniz pour la microélectronique haute performance (IHP), et depuis 2016, président du conseil d'administration de l'Institut Heinz Nixdorf. Sous sa direction, le groupe de Paderborn a méthodiquement progressé vers le record : en 2019, ils ont démontré un amplificateur track-and-hold avec une bande passante de 60 GHz, en 2020 avec 70 GHz, et en 2026, un niveau commercial de 500 Gbit/s par canal.
La décision clé a été de choisir le SiGe BiCMOS plutôt que le CMOS grand public ou la photonique exotique à l'arséniure d'indium (InP). Les transistors bipolaires à hétérojonction en silicium-germanium offrent des fréquences de commutation plusieurs fois supérieures à celles des MOSFET en silicium classiques pour des coûts de fabrication comparables. C'est sur cette technologie que l'équipe de Scheytt a optimisé le circuit track-and-hold — le cœur d'un convertisseur analogique-numérique qui capture la valeur instantanée d'un signal analogique et la maintient stable pendant que l'électronique en aval effectue la quantification.
La DFG a financé la deuxième phase du projet avec environ 390 000 €. À titre de comparaison, un seul lot de plaquettes de test chez GlobalFoundries ou IHP utilisant la technologie SiGe BiCMOS 130 nm coûte entre 150 000 € et 500 000 €. Les chercheurs ont travaillé avec des contraintes budgétaires serrées — et ont quand même réussi à extraire un record du processus.
Qui gagne et qui perd
Commençons par les gagnants.
Broadcom et Marvell sont les principaux bénéficiaires non annoncés. Les deux sociétés produisent des puces DSP pour les émetteurs-récepteurs optiques, et toutes deux utilisent le SiGe BiCMOS. Le record de Scheytt légitime les investissements dans le développement de cette plateforme pour l'Ethernet à 800G et 1,6T par voie unique. C'est particulièrement important pour Broadcom, qui pousse simultanément VCF 9.1 comme couche logicielle pour l'inférence IA : ils ont désormais aussi un argument matériel que la voie SiGe n'est pas épuisée.
GlobalFoundries et IHP (Institut Leibniz pour la microélectronique haute performance). Leurs usines détiennent des procédés SiGe BiCMOS clés (130 nm, 90 nm, et éventuellement 45 nm). Chaque record confirmant la viabilité de la technologie à des fréquences ultra-élevées prolonge la fenêtre de rentabilité de ces lignes. Remplacer l'équipement pour une usine CMOS 3 nm coûte 15 à 20 milliards de dollars ; affiner le procédé SiGe pour atteindre 500 Gbit/s par canal coûte environ 200 à 400 millions de dollars.
Les fabricants d'équipements de mesure — Keysight, Rohde & Schwarz, Tektronix. La puce de Scheytt "a poussé les systèmes de mesure existants à leurs limites". Cela crée immédiatement une demande pour une nouvelle génération d'oscilloscopes, d'analyseurs de réseaux vectoriels (VNA) et d'analyseurs de signaux capables de certifier des dispositifs avec une bande passante supérieure à 100 GHz. Le budget pour un tel instrument varie de 500 000 $ à 2 millions de dollars.
Maintenant les perdants.
Les startups photoniques pures (Ayar Labs, Lightmatter, Celestial AI). Elles promeuvent le récit : "le cuivre et les électrons sont épuisés ; l'avenir est aux interconnexions photoniques." Le record de Scheytt montre qu'une plateforme électronique pure en SiGe peut encore évoluer d'un ordre de grandeur. Si 500 Gbit/s sur un canal électronique deviennent commercialisés, une partie du marché des entrées-sorties optiques n'émergera tout simplement pas — du moins pour les distances intra-centre de données.
NVIDIA en tant que consommateur d'infrastructure réseau. NVIDIA promeut NVLink et InfiniBand comme interconnexions haute vitesse propriétaires. Un 500 Gbps standardisé sur une plateforme SiGe ouverte réduit la dépendance de l'industrie vis-à-vis des solutions verticales de NVIDIA dans la pile réseau. Cela ne le tuera pas, mais la marge sur le portefeuille réseau de NVIDIA pourrait en souffrir.
Les fabricants d'électronique à l'arséniure d'indium (InP). L'InP occupe traditionnellement le créneau au-dessus de 100 Gbit/s par canal. Le record SiGe prouve que la plateforme silicium empiète sur un territoire considéré comme le monopole de l'InP. Si cette transition se produit à l'échelle commerciale, les usines InP seront confrontées à une pression sur les prix comparable à celle subie par l'arséniure de gallium (GaAs) face au silicium dans les smartphones.
Ce que les médias ne disent pas
Voici la principale révélation qui manque dans 90 % des publications.
Le projet PACE (nom complet : "Convertisseur analogique-numérique photonique-électronique à ultra-large bande") a été initialement annoncé comme un programme électronique-photonique. La puce qui a fait les gros titres est purement électronique. Elle atteint le record sans composants photoniques.
Ce n'est pas une erreur mais une bifurcation architecturale au sein du programme. L'équipe de Scheytt poursuit simultanément la branche photonique : en 2020-2021, ils ont démontré une mesure de forme d'onde optique arbitraire sur une plateforme photonique en silicium. Mais maintenant, ils publient le résultat électronique. Pourquoi ? Parce que les convertisseurs analogique-numérique photoniques consomment en pratique trop de puissance optique des peignes de Kerr et nécessitent une stabilisation de température au centième de degré. Le track-and-hold électronique fonctionne simplement.
Cela pose une question inconfortable pour les sponsors du programme : si l'électronique délivre 500 Gbit/s sans photonique, pourquoi investir des centaines de millions d'euros dans l'hybridation photonique-électronique ? Il n'y a pas encore de réponse, mais son absence crée des tensions au sein du programme de recherche européen.
La deuxième révélation concerne le côté pratique des 100 Tbit/s. Les publications indiquent qu'une configuration multicanal peut délivrer plus de 100 Tbit/s. Cela semble impressionnant. Mais personne ne demande : combien d'énergie un tel système consomme-t-il ? Si 500 Gbit/s par canal nécessite, disons, 5 W (un chiffre typique pour un DSP de cette classe), alors 200 canaux pour 100 Tbit/s signifient un kilowatt rien que pour la conversion ADC. Ajoutez les lasers, les modulateurs, le DSP et le codage correcteur d'erreurs — vous obtenez un budget énergétique comparable à l'entraînement d'un petit réseau de neurones. C'est un problème d'ingénierie encore à résoudre — mais les communiqués de presse restent silencieux.
La troisième révélation : l'équipe a utilisé la modulation d'amplitude en quadrature (QAM) pour le codage bit-symbole compact. La QAM est sensible au bruit de phase — et selon Weizel, le bruit de phase était le principal ennemi. Ainsi, derrière le record se cache non seulement la conception de circuits, mais aussi un travail extrêmement complexe sur la suppression de la gigue à des fréquences où la longueur d'onde se mesure en sous-millimètres. Ce savoir-faire — probablement non public — constitue la valeur principale du groupe de Paderborn pour les licenciés potentiels.
Prévisions : les 30 et 90 prochains jours
30 jours (d'ici le 9 juin 2026)
L'événement principal de cette période est le silence. Ni Broadcom, ni Marvell, ni GlobalFoundries ne feront de déclarations publiques basées sur le record de Paderborn. C'est normal : les services juridiques vérifient la liberté d'exploitation des brevets, le développement commercial évalue si l'association avec un projet universitaire pourrait nuire aux négociations en cours avec les clients (en particulier au niveau des hyperscalers).
Bruit attendu : spéculations dans la presse et les blogs sur "la mort de NVIDIA InfiniBand" et "SiGe vs. photonique silicium". Les investisseurs dans Ayar Labs et Lightmatter recevront des questions de leurs commanditaires sur les menaces concurrentielles. Certains fonds de capital-risque commanderont des évaluations d'experts — et leurs conclusions influenceront le prochain tour de table d'une startup d'entrées-sorties optiques.
Dans le milieu académique, la reproduction commencera : des groupes de Berkeley, MIT et IMEC tenteront de reproduire le résultat sur leur propre matériel. Cela prendra plus de 30 jours, mais les premières demandes d'accès au PDK d'IHP suivront immédiatement.
90 jours (d'ici le 9 août 2026)
L'entonnoir de commercialisation commencera. L'équipe de Scheytt a de l'expérience dans la mise sur le marché de technologies : advICo microelectronics, cofondée par Scheytt en 2000, a vendu avec succès des blocs de propriété intellectuelle pour les systèmes fibrés. Une étape probable est le dépôt de brevets provisoires suivi d'une démonstration de la puce lors de la conférence BCICTS (Bipolar/BiCMOS Circuits and Technology Meeting), généralement organisée à l'automne. Si la démonstration a lieu, Broadcom et Marvell enverront des éclaireurs techniques.
Simultanément, un facteur politique émergera. Le financement de 390 000 € de la DFG est négligeable par rapport au CHIPS Act américain de 52 milliards de dollars ou aux investissements chinois dans Hua Hong Semiconductor. Les politiciens allemands commenceront à utiliser le record comme argument : "L'Europe n'a pas besoin de copier la voie des subventions asiatiques ; nous gagnons grâce à l'excellence technique." Cela influencera le budget d'Horizon Europe pour 2027-2033 dans la recherche sur les semi-conducteurs.
La principale chose à surveiller d'ici août 2026 est de savoir si un grand fabricant de modules optiques (Ciena, Infinera, Nokia) annonce des plans pour un émetteur-récepteur 800G ou 1,6T sur SiGe BiCMOS en référence à l'architecture de Paderborn. Si une telle annonce apparaît, cela confirme que l'industrie a misé sur le SiGe dans la course aux 100 Tbit/s. Sinon, le record restera une brillante démonstration en laboratoire, prolongeant la durée de vie des puces existantes d'une génération supplémentaire mais sans changer la direction architecturale de l'industrie.
Pour l'instant, on peut féliciter Paderborn : un petit groupe dans une ville universitaire allemande a prouvé que les électrons peuvent encore courir plus vite que le marché n'est prêt à l'accepter. C'est une réalisation dont le laboratoire Scheytt sera fier longtemps — peu importe qui, en fin de compte, la mettra dans une puce de production et empochera les milliards principaux.
— Editorial Team
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